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朱玥

作品数：6 被引量：14H指数：2
供职机构：中国科学院微电子研究所更多>>
发文基金：国家高技术研究发展计划更多>>
相关领域：电子电信自动化与计算机技术更多>>

合作作者

文献类型

  • 5篇期刊文章
  • 1篇学位论文

领域

  • 4篇电子电信
  • 2篇自动化与计算...

主题

  • 4篇处理器
  • 3篇图形处理器
  • 2篇多核
  • 2篇信号量
  • 2篇邮箱
  • 1篇单指令多数据
  • 1篇顶点
  • 1篇多核系统
  • 1篇多线程
  • 1篇映射
  • 1篇帧内预测
  • 1篇体系架构
  • 1篇同构
  • 1篇嵌入式
  • 1篇嵌入式应用
  • 1篇自旋锁
  • 1篇纹理
  • 1篇纹理映射
  • 1篇线程
  • 1篇媒体处理

机构

  • 6篇中国科学技术...
  • 5篇中国科学院微...

作者

  • 6篇朱玥
  • 5篇陈杰
  • 2篇刘建
  • 2篇王云
  • 2篇奚杰
  • 2篇申智波
  • 1篇周莉
  • 1篇喻庆东
  • 1篇胡哲琨

传媒

  • 2篇微电子学与计...
  • 1篇系统工程与电...
  • 1篇哈尔滨工业大...
  • 1篇电子科技大学...

年份

  • 4篇2012
  • 1篇2011
  • 1篇2010
共 6 条 记 录，以下是 1-6
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排序方式：
可编程的帧内预测器结构设计与实现
2012年
针对超低成本超低功耗便携式移动应用,基于可编程的思想,提出了一种独特的适用于H.264/AVC和AVS双模解码器的帧内预测器架构。该架构利用H.264/AVC和AVS帧内预测在数据通路上的相似性,通过定制专有的8位微指令集和高效的数据通路,实现了一个专用可编程内核,该内核仅包含一个16位累加器和一个16位桶形移位器。实现结果表明,在0.18 m工艺下,逻辑规模仅为6.3K等效逻辑门;电路在35 MHz工作频率下可以实时处理D1(720×480)格式30 f/s的H.264/AVC和AVS视频序列;在1.8 V电压下功耗仅为0.53 mW,具有面积小、功耗低、灵活性好的特点。
喻庆东周莉朱玥胡哲琨陈杰
关键词：AVSH.264/AVC
适用于嵌入式应用的多线程顶点处理器设计被引量：1
2012年
针对嵌入式应用中三维图形渲染的要求,设计了一款可编程的多线程顶点处理器.该顶点处理器采用单指令多数据结构,一条指令能够同时处理4个单精度浮点数,并采用多线程技术,支持4个线程并发执行,能够有效地减少发生数据写读冲突时的停顿周期数,提高了处理效率.相对于单线程结构,4线程顶点处理器在较小的硬件开销下,可以实现2.1～2.8倍的性能提升.该顶点处理器支持OpenGL ES 1.1和Vertex Shader Model 1.1,在90nm CMOS工艺库下可实现频率为200MHz,性能为50Mvertices/s.
申智波陈杰刘建王云朱玥
关键词：图形处理器多线程单指令多数据嵌入式应用
Tile-Based图形处理方法及高质量图形算法设计
Tile-Based体系架构以其独特的三维图形显示算法，在嵌入式图形处理器设计领域内占有重要地位[1]。其最显著特征是将屏幕分割为许多小块区域分别进行场景的绘制渲染。这种显示算法与传统的图形显示流水线并不相同，带来的最大...
朱玥
关键词：图形处理器
文献传递
实现空间异性纹理映射的查找表方法
2012年
为了在移动平台中得到高质量、高实时性的纹理显示,设计并实现了一种基于查找表的各向异性纹理映射方法。该方法通过改变归一化椭圆足迹模型的自变量选择,精确测量各参数量化对图像质量的影响,由此建立查找表获得足迹组合滤波中的所需参数。在此基础上,根据系统有效带宽的限制,加入动态调节纹理映射带宽需求的参数选择功能。实验表明,该滤波方法显示质量高,计算复杂度低,且具有带宽可控的优点,适于移动平台实现。
朱玥陈杰刘建王云申智波
关键词：图形处理器纹理映射
高性能同构多核媒体处理器
2011年
为了大幅提高处理器的处理能力,设计了一款5核结构的同构多核处理器并实现了H.264在多核处理器上的并行解码.该多核处理器采用1个CPU作为主控处理器,另外的4个CPU作为受控处理器被调用,5个CPU可以同时访问1块32 KWord的共享存储器,任意2个CPU之间可以通过邮箱、信号量、硬件锁实现点对点的通讯.其中,主控处理器负责码流解析、帧内预测模式、运动向量、边界强度的计算,并把中间数据存储到共享存储器中;4个受控处理器每次取1行宏块数据处理.试验结果表明,采用行并行的解码方式,5核系统较传统的双核系统达到约3.6倍的加速比.该并行解码方法同样适用于其他的视频协议,具有广泛的通用性.
奚杰朱玥陈杰
关键词：多核邮箱H.264信号量
利用SystemC实现多核系统的快速建模被引量：11
2010年
在多核系统设计中,传统的Verilog/VHDL等语言由于仿真速度慢的缺点,不适合多核处理器建模.为实现快速建模,文中利用SystemC对多核处理器进行建模,并且给出了处理器、共享存储区、信号量、邮箱、自旋锁等模块的建模方法.通过详细的性能分析,寻找系统的性能瓶颈并改进设计.在此基础上,采用手动翻译的方法,实现了可综合的Verilog多核处理器模型.仿真结果显示,SystemC模型相对于Verilog模型可以使仿真速度提高约15倍,并且建模简单,周期级的仿真精确性较高.
奚杰陈杰朱玥
关键词：多核SYSTEMC信号量邮箱自旋锁
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