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周海斌

作品数：19 被引量：64H指数：4
供职机构：中国电子科技集团第十四研究所更多>>
相关领域：电子电信自动化与计算机技术更多>>

合作作者

文献类型

  • 11篇期刊文章
  • 8篇专利

领域

  • 10篇电子电信
  • 6篇自动化与计算...

主题

  • 4篇处理器
  • 3篇多通道
  • 3篇信号
  • 3篇信号处理
  • 3篇转置
  • 3篇矩阵
  • 3篇雷达
  • 3篇DMA
  • 3篇乘法
  • 3篇高性能
  • 2篇信号处理算法
  • 2篇信息选择
  • 2篇移位器
  • 2篇软件数据
  • 2篇数据预取
  • 2篇向量
  • 2篇灵活性
  • 2篇滤波器
  • 2篇阶数
  • 2篇矩阵乘

机构

  • 19篇中国电子科技...
  • 5篇江苏华创微系...
  • 1篇北京国睿中数...

作者

  • 19篇周海斌
  • 6篇陈铠
  • 5篇何国强
  • 4篇刘刚
  • 4篇李世平
  • 1篇李明
  • 1篇鲍胜荣
  • 1篇陈晓东

传媒

  • 4篇现代雷达
  • 2篇电子工程师
  • 1篇电子技术（上...
  • 1篇遥测遥控
  • 1篇机电信息
  • 1篇信息化研究
  • 1篇科学与信息化

年份

  • 1篇2024
  • 4篇2023
  • 2篇2022
  • 1篇2021
  • 4篇2020
  • 1篇2017
  • 1篇2013
  • 1篇2012
  • 1篇2009
  • 1篇2008
  • 2篇2005
共 19 条 记 录，以下是 1-10
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排序方式：
一种基于内嵌DMA的处理器数据预取设计
本发明结合了软件预取的高度灵活性和硬件预取的高效率，提出了一种通过在矢量处理器核内部设计内嵌DMA的方法，与传统的通过Load/Store或矢量Load/Store指令从片外存储搬运数据方式和通过指令实现的软件数据预取方...
周海斌魏为
文献传递
一种可重构信号处理运算单元及基于其的重组单元
本发明公开了一种可重构信号处理运算单元，包括：控制模块，接收重构信息，根据重构信息选择数据通路，配置可重构运算电路模块的工作模式；可重构运算电路模块，根据输入数据根据进行数据的运算，得到运算结果；输出模块，用于将可重构运...
陈铠李世平何国强周海斌
文献传递
一种多通道流水FIR滤波器
本发明公开一种多通道流水FIR滤波器，包括通道合并装置、零级滤波单元、若干个串联的通用滤波单元和通道拆分装置，M路输入数据经所述通道合并装置后合并为一路输出；零级滤波单元的一路输出信号进入缓冲移位器，经缓冲移位进入到第二...
李世平陈铠周海斌何国强
基于FPGA的高速实时FFT处理器设计被引量：19
2005年
结合高速、实时快速傅里叶变换(FFT)的实际需求,在分析了基4、按频率抽取(DIF)FFT算法的基础上,采用多级串行的同步流水线结构,利用现场可编程门阵列(FPGA)完成1024点、16位复数点、块浮点FFT。整个设计划分成多个功能模块,全部采用VerilogHDL描述,并在VirtexⅡ器件上实现。结果表明,利用FPGA实现复杂的数字信号处理(DSP)算法是完全可行的。
周海斌刘刚
关键词：块浮点VERILOGHDL
静态时序分析在高速FPGA设计中的应用被引量：23
2005年
介绍了采用STA(静态时序分析)对FPGA(现场可编程门阵列)设计进行时序验证的基本原理,并介绍了几种与STA相关联的时序约束。针对时序不满足的情况,提出了几种常用的促进时序收敛的方法。结合设计实例,阐明了STA在高速、大规模FPGA开发中的应用。实践表明,随着数字设计复杂度的增加,在后端的时序验证环节,与传统的动态门级时序仿真相比,采用STA方法的优势在于可以全面、高效地完成验证任务。
周海斌
关键词：FPGA
一种可重构信号处理运算单元及基于其的重组单元
本发明公开了一种可重构信号处理运算单元，包括：控制模块，接收重构信息，根据重构信息选择数据通路，配置可重构运算电路模块的工作模式；可重构运算电路模块，根据输入数据根据进行数据的运算，得到运算结果；输出模块，用于将可重构运...
陈铠李世平何国强周海斌
基于ADRES处理器的并行FFT设计及实现
2022年
根据动态可重构嵌入式系统架构(ADRES)处理器单指令多数据流(SIMD)结构的特点,提出了一种基于SIMD的并行化快速傅里叶变换(FFT)算法,其在每个指令周期并行执行8个基4蝶形运算,同时将数据混洗和地址倒序操作嵌入向量蝶形运算过程中执行,既保证了向量运算的并行度,也掩盖了FFT结果倒序所需的时间。该算法在ADRES处理器上实现,结果显示,与其他同等规模运算资源的处理器相比,处理性能达到1.1~10倍。
李世平陈铠陈晓东周海斌何国强
基于SiP技术的雷达信号处理微系统设计被引量：2
2021年
系统级封装SiP(System in a Package)已成为后摩尔时代延续摩尔定律的主要技术路线,是未来电子装备小型化和多功能化的重要依托,在微纳电子设计和制造领域具有广阔的应用市场和发展前景。介绍了系统级封装技术的发展和应用情况,根据雷达信号处理系统芯片化、集成化、高能效、高可靠的发展需求,探讨了SiP技术在雷达信号处理系统中应用的可行性,提出了一种基于SiP技术的雷达信号处理微系统设计及实现,SiP产品比PCB板卡面积缩小60%以上。
周海斌何国强
关键词：系统级封装雷达信号处理微系统
一种多波特率串口控制器的设计与实现
2023年
本文面向DSP芯片的应用需求,设计并实现了一种多波特率的串口控制器(MB-UART,Multi-Baud Rate UART)IP软核,对内支持APB总线接口,对外支持标准的串行总线,该控制器结构简洁、使用方便、可扩展性强,可以稳定的实现与PC机的串口通信,并支持多种不同的波特率,数据传输准确、可靠,且支持PC机通过串口将Boot程序烧录到片外Flash中,实现对Boot程序的更新,可以广泛应用于各类SoC芯片。
李世平张同新周海斌
关键词：UART
基于AMBA总线的相控阵雷达波控SoC设计被引量：6
2008年
针对相控阵雷达波控系统高速、小型化、集成化的发展趋势,提出了一种基于ARM核和先进微控制器总线架构的波控片上系统方案,对主要组成模块的设计和验证方法进行了详细描述。验证结果表明,波控片上系统结合了硬件运算模块高速和软件设计灵活的特点,可满足各种相控阵雷达不同工作方式的需求。
周海斌刘刚
关键词：相控阵天线波控系统
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