杨皓
- 作品数：5 被引量：9H指数：1
- 供职机构：重庆邮电大学光电工程学院更多>>
- 发文基金：国家自然科学基金更多>>
- 相关领域：电子电信更多>>
- 一种基于FPGA进位链的时间数字转换器被引量：8
- 2016年
- 提出了一种基于Xilinx Virtex-5FPGA的时间数字转换器。利用Virtex-5中专用进位链CARRY4构造的延迟链,对时钟周期进行内插以得到更高精度的测量。此外,运用布局布线约束来减少延迟链的不一致性,降低了微分非线性（DNL）以及积分非线性（INL）。仿真结果表明,最低有效位（LSB）为52.22ps,精度（RMS）约为25ps,INL为0~0.9LSB,DNL为-0.03~0.1LSB。
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- 关键词：进位链布局布线可编程逻辑器件
- 应用于流水线ADC的LMS自适应校准算法与FPGA实现
- 2018年
- 研究了应用于流水线模数转换器(ADC)的LMS自适应数字校准算法及其FPGA实现。该校准算法可用于校准大多数已知的误差,包括非线性运算放大器的有限增益、电容失配,以及比较器的失调等。通过Simulink软件,对一个12位160MS/s的流水线ADC进行建模。采用LMS自适应校准算法对该流水线ADC进行校准,并将算法在Virtex-5上实现了硬件设计。实验结果表明,输入信号频率为58.63MHz时,流水线ADC的无杂散动态范围(SFDR)和有效位(ENOB)分别由校准前的46.31dB和7.32位提高到校准后的82.03dB和11.12位。
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- 关键词：流水线模数转换器LMS自适应算法
- 一种SiGe BiCMOS 3级级联60GHz LNA
- 2017年
- 基于0.18μm SiGe BiCMOS工艺,设计了一种高增益单端3级级联60GHz低噪声放大器。级间匹配采用LC谐振,以减小传输损耗,引入的级间电感L与上级输出寄生电容、下级输入寄生电容谐振,以减小寄生效应的影响。在3.3V供电电压下,60GHz频率处的功率增益S_(21)达到21.8dB,噪声系数NF为6.1dB;在58~65GHz频段内,输入和输出反射系数S_(11)和S_(22)均小于-10dB。
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- 关键词：低噪声放大器噪声系数
- 一种基于维纳延迟环的高线性度TDC被引量：1
- 2018年
- 设计了一种基于维纳延迟环的时间数字转换器(TDC)。该TDC基于TSMC 0.18μm CMOS工艺进行设计,实现了高分辨率和高线性度。采用一种新型环形传播延迟结构来代替时钟信号,相比传统结构,减少了1组粗-精2级插值器的使用。粗计数器由该新型环形传播延迟结构和6位计数器构成,实现了输入的START信号与周期信号同步,测量动态范围达到208ns。粗-精2级插值器中,第1级由粗插值器和同步器构成,第2级是一个基于单阶维纳环的精插值器。利用维纳环的循环滑动测量技术,有效提高了TDC的转换线性度。仿真结果表明,该TDC的分辨精度可达10ps,微分非线性低于20ps,积分非线性低于30ps。
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- 一种60 GHz CMOS高效率功率放大器
- 2018年
- 为了满足短距离无线高速传输的应用需求,基于SMIC 90nm 1P9M CMOS工艺,设计了一种可工作在60GHz的功率放大器(PA)。该PA为单端三级级联结构。采用顶层金属方法,设计具有高品质因子的小感值螺旋电感,用于输入、输出和级间匹配电路,以提高电路的整体性能。通过减少传输损耗和输出匹配损耗,提高了附加功率效率。仿真结果表明,在1.2V电源电压下,该PA的功率增益为17.2dB,1dB压缩点的输出功率为8.1dBm,饱和输出功率为12.1dBm,峰值功率附加效率为15.7%,直流功耗为70mW。各性能指标均满足60GHz通信系统的要求。
- 王巍黄孟佳杨皓杨正琳袁军王伊昌
- 关键词：CMOS功率放大器功率附加效率
