郝威
- 作品数：2 被引量：8H指数：1
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- 基于FPGA的合并单元关键技术的实现
- 合并单元，简称MU，是一种对一次互感器传输过来的电气量进行合并和同步处理，并将处理后的数字信号按照特定格式转发给间隔层设备使用的装置，是电子式电流、电压互感器的接口装置。本文介绍了FPGA在合并单元功能实现中,高实时性,...
- 牟涛樊占峰赵应兵郝威
- 关键词：互感器合并单元时间同步
- 文献传递
- 基于高性能FPGA的合并单元设计与实现被引量：8
- 2016年
- 介绍了在合并单元功能实现中FPGA高实时性、高精度、高可靠性的应用,重点介绍了采用FPGA实现合并单元点对点SV报文收发的方法,通过FPGA实现合并单元时间同步及守时的原理及方法。在点对点SV报文收发过程中,FPGA控制DM9000C,将接收到的SV报文放在FIFO中缓存,并通过内部定时器对接收的报文打时标,在SV报文接收的间隙,FPGA配合CPU精确地控制SV报文的发送时间,保证其离散性控制在100 ns以内。在对时状态下,通过FPGA解析B码和和1588对时信息,保持合并单元的时间同步,并采用跟随算法记录秒脉冲时间间隔。在丢失外部同步信号时,FPGA时间同步模块无缝切换到守时状态,并能在长时间内保证合并单元的守时精度。
- 牟涛任志航樊占峰赵应兵郝威王楠
- 关键词：合并单元FPGAIEC61850时钟同步
