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李红桥
作品数:
19
被引量:2
H指数:1
供职机构:
西安微电子技术研究所
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相关领域:
自动化与计算机技术
电子电信
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合作作者
赵翠华
西安微电子技术研究所
张海金
西安微电子技术研究所
崔媛媛
西安微电子技术研究所
李磊
西安微电子技术研究所
张洵颖
西安微电子技术研究所
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一种提高处理器主频的流水线细分装置
本发明公开了一种提高处理器主频的流水线细分装置,其连接顺序依次为指令Cache访问级、指令Cache选择级、译码级、寄存器访问级、执行级、数据Cache访问级、数据Cache选择级、异常处理级和数据写回级。通过降低片上一...
肖建青
张洵颖
李红桥
赵翠华
崔媛媛
文献传递
一种提高处理器主频的流水线细分装置
本发明公开了一种提高处理器主频的流水线细分装置,其连接顺序依次为指令Cache访问级、指令Cache选择级、译码级、寄存器访问级、执行级、数据Cache访问级、数据Cache选择级、异常处理级和数据写回级。通过降低片上一...
肖建青
张洵颖
李红桥
赵翠华
崔媛媛
一种正交编码脉冲信号的零位检测方法及系统
本发明公开了一种正交编码脉冲信号的零位检测方法及系统,通过将输入信号转换为计数方向信号、计数脉冲信号和零位脉冲信号,根据检测到的第一个零位脉冲信号确定初始零位,将初始零位发生时的正交编码脉脉冲信号的沿变信息、位置计数值和...
张海金
崔媛媛
李红桥
刘思源
一种时钟管理电路及基于该电路的服务级芯片
本发明公开了一种时钟管理电路及基于该电路的服务级芯片,包括时钟管理电路,其特征在于,包括使用三个分频电路对输入时钟信号进行分频,且三个分频电路的输出结果经过三模判决后的时钟信号输入给锁相环;其中锁相环还设置有四选一选择器...
李红桥
张海金
赵翠华
张洵颖
崔媛媛
田超
文献传递
流水线处理器中Cache模块的设计
被引量:2
2010年
流水线结构能大幅提高指令执行速度,但是由于主存读取速度过慢,系统性能的提升仍然受到限制。现实现的Cache设计,是流水线与主存间的高速缓冲器,它能有效地解决访存的瓶颈问题,使流水线功能得到充分发挥。文章首先分析流水线的结构特点,确定Cache的结构功能,在此基础上提出一个组相联映射Cache的设计。分析Cache实现读写操作的具体控制过程,并给出LRU(least recently used)替换算法的实现。最后通过介绍猝发取指操作着重讨论了Cache与流水线间的配合机制。
李红桥
肖建青
张洵颖
龚龙庆
关键词:
流水线
组相联
一种SoC系统复位期间锁相环稳定时钟输出电路
本发明一种SoC系统复位期间锁相环稳定时钟输出电路,包括复位预处理模块、锁相环和时钟生成模块;所述复位预处理模块的输入端连接复位输入和时钟输入,输出端输出预处理后复位信号;锁相环的输入端连接预处理后复位信号、时钟输入和配...
赵翠华
张海金
张春妹
王会敏
李红桥
张斌
谢琰瑾
文献传递
一种用于测试SoC功能的测试电路、测试方法和SoC
本发明公开了一种用于测试SoC功能的测试电路、测试方法和SoC,当测试模式控制寄存器配置SoC为测试模式时,管脚复用选择模块切换并行PROM复用管脚选择片外测试用并行PROM接口,此时:片内测试加载程序控制器用于通过片外...
赵翠华
李磊
李红桥
罗敏涛
娄冕
刘思源
肖刚
翟孟奎
文献传递
一种基于交叉存储的Cache实现方法
本发明公开了一种基于交叉存储的Cache实现方法,在满足<Image file="DDA0001681431740000011.GIF" he="126" imgContent="drawing" imgFormat="...
崔媛媛
李红桥
郭娜娜
谢琰瑾
杨博
一种适用于多种位宽并行输入数据的CRC校验控制系统
本发明公开了一种适用于多种位宽并行输入数据的CRC校验控制系统,AHB接口单元实现对AHB访问协议的解析;CRC计算单元对数据源进行CRC计算后,将CRC值进行输出;CRC预置值单元用于和CRC计算的结果进行比较;比较单...
李磊
罗敏涛
赵翠华
李红桥
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张斌
文献传递
一种正交编码脉冲信号的零位检测方法及系统
本发明公开了一种正交编码脉冲信号的零位检测方法及系统,通过将输入信号转换为计数方向信号、计数脉冲信号和零位脉冲信号,根据检测到的第一个零位脉冲信号确定初始零位,将初始零位发生时的正交编码脉脉冲信号的沿变信息、位置计数值和...
张海金
崔媛媛
李红桥
刘思源
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