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文献类型

  • 7篇专利
  • 2篇期刊文章

领域

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主题

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  • 2篇网表
  • 2篇流水线
  • 2篇名字
  • 2篇可配置
  • 2篇累加器

机构

  • 9篇中国电子科技...

作者

  • 9篇刘瑛
  • 7篇万清
  • 5篇冯盛
  • 5篇胡凯
  • 4篇闫华
  • 4篇丛红艳
  • 2篇于宗光
  • 2篇单悦尔

传媒

  • 2篇电子与封装

年份

  • 1篇2019
  • 2篇2016
  • 6篇2014
9 条 记 录,以下是 1-9
排序方式:
可配置可扩展的流水线乘累加器
本实用新型公开了一种可配置可扩展的流水线乘累加器,属于集成电路设计领域,该可配置可扩展的流水线乘累加器在结构设计中增加控制选择器,从而能够使得该可配置可扩展的流水线乘累加器能根据用户的应用要求,通过采取不同的配置方式实现...
胡凯冯盛万清闫华刘瑛
文献传递
用于大容量FPGA电路功能仿真的最优网表的生成方法
本发明涉及一种用于大容量FPGA电路功能仿真的最优网表的生成方法,可以根据FPGA电路使用资源动态生成最优网表。该方法需要获取全芯片网表中顶层单元所有单元名字以及例化单元名字,得到全芯片网表的配置文件。然后根据FPGA电...
丛红艳于宗光闫华胡凯刘瑛单悦尔
文献传递
一种BLOCK RAM级联实现结构
本实用新型涉及一种BLOCKRAM级联实现结构,其包括一列BLOCKRAM;一列BLOCKRAM内相邻的两个BLOCKRAM间通过第二级ASIC级联逻辑布线结构使得所述两个BLOCKRAM间进行地址级联,以形成一个所需地...
刘瑛冯盛万清
文献传递
一种BLOCK RAM级联实现结构
本发明涉及一种BLOCK RAM级联实现结构,其包括一列BLOCK RAM;一列BLOCK RAM内相邻的两个BLOCK RAM间通过第二级ASIC级联逻辑布线结构使得所述两个BLOCK RAM间进行地址级联,以形成一个...
刘瑛冯盛万清
文献传递
可配置可扩展的流水线乘累加器
本发明公开了一种可配置可扩展的流水线乘累加器,属于集成电路设计领域,该可配置可扩展的流水线乘累加器在结构设计中增加控制选择器,从而能够使得该可配置可扩展的流水线乘累加器能根据用户的应用要求,通过采取不同的配置方式实现乘、...
胡凯冯盛万清闫华刘瑛
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一种FPGA中BRAM36k的设计方法被引量:1
2014年
BRAM以阵列的方式排布于FPGA内部,是FPGA实现各种存储功能的主要部分。FPGA通过BRAM以及可编程逻辑资源给用户提供各种不同的存储资源。介绍了FPGA其中可编程存储模块BRAM36k的具体功能以及实现方法。该模块支持多种地址和数据位宽纵横比组合、多种读接口和写接口数据带宽转换,支持奇偶校验bit写入和读出。最后对模块的功能进行了功能级仿真验证,仿真结果符合预期设计目标。
刘瑛胡凯丛红艳万清
关键词:FIFO奇偶校验
基于格雷码的深度可配置的异步FIFO设计实现
2014年
如何防止产生亚稳态问题,更好地同步异步信号及准确地设计空、满、几乎空、几乎满控制信号的产生是异步FIFO设计的两大难点。介绍了一种异步FIFO的设计方法,用先比较读写地址产生空满标志,再同步到相应的时钟域的方法来准确设计标志位信号的产生。采用格雷(Gray)码来避免亚稳态的出现,性能较稳定,并比较了利用Gray码、单步循环码作异步FIFO指针的优缺点。最后,给出了系统的仿真及综合结果。
丛红艳刘瑛万清
关键词:FIFO亚稳态GRAY码
一种BLOCK RAM级联实现结构
本发明涉及一种BLOCKRAM级联实现结构,其包括一列BLOCKRAM;一列BLOCKRAM内相邻的两个BLOCKRAM间通过第二级ASIC级联逻辑布线结构使得所述两个BLOCKRAM间进行地址级联,以形成一个所需地址深...
刘瑛冯盛万清
文献传递
用于大容量FPGA电路功能仿真的最优网表的生成方法
本发明涉及一种用于大容量FPGA电路功能仿真的最优网表的生成方法,可以根据FPGA电路使用资源动态生成最优网表。该方法需要获取全芯片网表中顶层单元所有单元名字以及例化单元名字,得到全芯片网表的配置文件。然后根据FPGA电...
丛红艳于宗光闫华胡凯刘瑛单悦尔
共1页<1>
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