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叶云飞
作品数:
12
被引量:5
H指数:1
供职机构:
南京航空航天大学
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发文基金:
国家自然科学基金
江苏省产学研前瞻性联合研究项目
江苏省高校自然科学研究项目
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相关领域:
电子电信
自动化与计算机技术
交通运输工程
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合作作者
吴宁
南京航空航天大学电子信息工程学...
葛芬
南京航空航天大学电子信息工程学...
张肖强
南京航空航天大学电子信息工程学...
周芳
南京航空航天大学电子信息工程学...
魏永康
南京航空航天大学
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机构
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作者
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叶云飞
9篇
吴宁
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葛芬
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张肖强
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周芳
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战金玉
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孙科
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张颖
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周磊
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魏永康
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叶云飞
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2014
2篇
2013
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具有全局通信事务管理能力的容错片上网络系统及方法
本发明公开了一种具有全局通信事务管理能力的容错片上网络系统,该系统以网络监控器与容错路由器为核心通过专用总线互连构成。本发明还公开了应用于上述容错片上网络系统的路径分配方法和网络数据传输方法。本发明能实现对全局网络状态的...
葛芬
吴宁
张颖
叶云飞
徐文涛
郑锦涛
文献传递
适用于片上网络嵌入式IP核的测试壳
本发明公开了适用于片上网络嵌入式IP核的测试壳,属于嵌入式IP核测试的技术领域。所述于片上网络嵌入式IP核的测试壳,包括并行输入端口、并行旁路寄存器、并行输出端口、串行输入端口、串行旁路寄存器、串行输出端口、测试控制寄存...
张颖
吴宁
叶云飞
兰利东
周芳
葛芬
文献传递
无缝钢轨巴克豪森信号检测与传输电路优化设计方法研究
针对多因素作用下的巴克豪森信号特征值变化关系的评估模型缺乏、相关性分析不足等关键性研究难点,和电路资源配置限制、电磁环境复杂条件下检测信号安全、稳定、高效传输的研究存在不足等情况。论文通过建立深度变化、温度变化和磁轭提离...
叶云飞
关键词:
无缝钢轨
信号传输
温度变化
文献传递
一种嵌入式高精度网络时间服务器系统
本发明公开了一种嵌入式高精度时钟服务器系统,该系统时钟源接入及解码模块、微秒时间计数模块、时间信息寄存器模块、网络时间服务器接口模块、网络时间服务器模块、系统存储模块和系统远程访问模块组成。该系统可根据信号质量自动选择G...
周磊
吴宁
张肖强
叶云飞
战金玉
葛昀
孙科
武治平
文献传递
基于数据冗余检错机制的AES加/解密电路
本发明公开了一种基于数据冗余检错机制的AES加/解密电路,用于抵御错误注入攻击或用于提高在极端应用环境中的电路可靠性。电路包括AES加/解密单元和比较器两部分,AES加/解密单元用于AES加/解密运算,AES加/解密单元...
吴宁
张肖强
葛芬
叶云飞
魏永康
刘摇平
用于铁轨探伤的系统及其方法
一种用于铁轨探伤的系统及其方法,包括钢轨探伤仪,用于采集钢轨探伤数据并接收来自GPS定位设备的钢轨探伤仪的定位数据,以及还用于将所述钢轨探伤数据和所述定位数据通过无线网络发送给服务器;所述服务器设置在主控箱内,所述主控箱...
叶云飞
吴宁
葛芬
周芳
文献传递
一种多重约束下的NoC电压频率岛划分方法
2014年
针对高性能低功耗的片上网络设计问题,提出一种多重约束下的电压频率岛划分方法.该方法以优化片上网络系统总能耗为目标,综合考虑电压频率岛个数、传输延时及网络中各PE节点的可靠性等多重约束条件,构建了适用于ILP的数学模型以解决片上网络的电压频率岛划分问题.使用LPSolve求解器对所建模型求解,并从E3 S测试基准中选用多组测试用例和一个多媒体系统实例,验证了该方法的有效性.实验结果表明,该电压频率岛划分方法可在满足多重约束条件的同时,更加合理地划分片上网络的电压频率岛,有效地降低网络能耗.相比于随机划分方法和其他经典的划分方法,该方法可降低能耗9.1%~33.6%和16.7%.
周芳
吴宁
叶云飞
葛芬
关键词:
片上网络
整数线性规划
能耗
一种嵌入式高精度网络时间服务器系统
本发明公开了一种嵌入式高精度时钟服务器系统,该系统时钟源接入及解码模块、微秒时间计数模块、时间信息寄存器模块、网络时间服务器接口模块、网络时间服务器模块、系统存储模块和系统远程访问模块组成。该系统可根据信号质量自动选择G...
周磊
吴宁
张肖强
叶云飞
战金玉
葛昀
孙科
武治平
文献传递
基于数据冗余检错机制的AES加/解密电路
本发明公开了一种基于数据冗余检错机制的AES加/解密电路,用于抵御错误注入攻击或用于提高在极端应用环境中的电路可靠性。电路包括AES加/解密单元和比较器两部分,AES加/解密单元用于AES加/解密运算,AES加/解密单元...
吴宁
张肖强
葛芬
叶云飞
魏永康
刘摇平
文献传递
基于多因子CSE算法的AESS-盒电路优化设计
被引量:5
2014年
针对高级加密标准(AES)S-盒优化,提出了一种新的多因子公共项消除(CSE)优化算法.多因子CSE算法通过对组合逻辑表达式中所含因子最多的公共项优先消除,以简化逻辑表达式,从而有效地减少S-盒电路结构中的GF(2^4)域乘法逆电路和映射矩阵电路的面积和时延.结果表明,多因子CSE算法具有计算速度快,优化效率高的特点.优化后的S-盒组合逻辑电路采用0.18μm CMOS工艺,设计出的S-盒面积-延时积比目前最小面积和最短延时的S-盒组合逻辑电路分别减少了10.32%和19.64%.
曾纯
吴宁
张肖强
周芳
叶云飞
关键词:
S-盒
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