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盛廷义

作品数：16 被引量：0H指数：0
供职机构：中国航天科技集团公司第九研究院第七七一研究所更多>>
相关领域：电子电信更多>>

合作作者

文献类型

  • 16篇中文专利

领域

  • 1篇电子电信

主题

  • 11篇寄存器
  • 5篇总线
  • 5篇处理器
  • 3篇单发
  • 3篇读写
  • 3篇硬件
  • 3篇通用接口
  • 3篇外设
  • 3篇内核
  • 3篇接口
  • 3篇寄存器组
  • 2篇点运算
  • 2篇硬件电路
  • 2篇运算器
  • 2篇三角函数
  • 2篇时钟
  • 2篇嵌入式
  • 2篇嵌入式处理器
  • 2篇主存
  • 2篇芯片

机构

  • 16篇中国航天科技...

作者

  • 16篇盛廷义
  • 14篇陈庆宇
  • 10篇段青亚
  • 9篇吴龙胜
  • 6篇李小波
  • 4篇唐威
  • 2篇李立
  • 2篇赵恒星
  • 2篇陈佳杰
  • 2篇张佳
  • 2篇赵鲲鹏
  • 1篇李剑
  • 1篇马毅超

年份

  • 1篇2018
  • 1篇2016
  • 6篇2015
  • 1篇2014
  • 4篇2013
  • 3篇2012
共 16 条 记 录，以下是 1-10
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排序方式：
基于CORDIC算法的反馈和流水线结构相结合的三角函数运算器
本发明公开了一种基于CORDIC算法的反馈和流水线结构相结合的三角函数运算器，包括基于软件配置的寄存器组模块、运算控制模块及伪流水运算迭代单元组成。基于软件配置的寄存器组模块包括A、B两类寄存器；运算控制模块负责寄存器组...
陈庆宇盛廷义李小波李立陈佳杰
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总线从单元通用接口
本发明公开了一种总线从单元通用接口，包括总线从单元接口模块、时钟处理单元、同步单元、RAM控制逻辑产生单元、数据缓冲单元FIFO、寄存器单元和特殊处理单元；所述RAM控制逻辑产生单元、寄存器单元、特殊处理单元和时钟处理单...
盛廷义段青亚吴龙胜陈庆宇李小波
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一种面向RISC处理器的三端口浮点寄存器文件
本发明公开了一种面向RISC处理器的三端口浮点寄存器文件，通过在寄存器文件的输入信号中，增加源操作数和目标操作数的精度标志位，寄存器阵列的控制逻辑根据精度标志位和读写标志位，对源操作数和目标操作数地址指定的寄存器及与它地...
陈庆宇吴龙胜段青亚盛廷义唐威
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一种面向RISC处理器的三端口浮点寄存器文件
本发明公开了一种面向RISC处理器的三端口浮点寄存器文件，通过在寄存器文件的输入信号中，增加源操作数和目标操作数的精度标志位，寄存器阵列的控制逻辑根据精度标志位和读写标志位，对源操作数和目标操作数地址指定的寄存器及与它地...
陈庆宇吴龙胜段青亚盛廷义唐威
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总线从单元通用接口
本实用新型公开了一种总线从单元通用接口，包括总线从单元接口模块、时钟处理单元、同步单元、RAM控制逻辑产生单元、数据缓冲单元FIFO、寄存器单元和特殊处理单元；所述RAM控制逻辑产生单元、寄存器单元、特殊处理单元和时钟处...
盛廷义陈庆宇段青亚李小波马毅超
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一种芯片间的数据传输方法
本发明公开了一种芯片间的数据传输方法，包括以下步骤：1)对所要传输的数据进行编码，得到串行格式的数据，根据串行格式的数据生成纠错码，其中，串行格式的数据帧构成包括数据的起始位、逻辑通道、数据实体、数据的纠检错位和保护间隙...
张佳盛廷义唐威
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一种单发射流水线处理器
本实用新型公开了一种单发射流水线处理器，包括取指级、译码级、执行级、存储器访问级和写回级，其特征在于，在译码级、执行级、存储器访问级和写回级相邻两级之间均设有异常标志寄存器；在取指级中增设异常检测模块、多输入或门、多路选...
陈庆宇盛廷义段青亚吴龙胜
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一种基于反相逻辑的三模冗余表决电路
本实用新型提供一种TMR表决电路硬件消耗低，关键路径缩短的基于反相逻辑的三模冗余表决电路，其包括第一两输入与非门、第二两输入与非门、第三两输入与非门及三输入与非门；三模冗余表决电路的三个输入两两分别连接至第一两输入与非门...
陈庆宇马徐瀚赵鲲鹏吴龙胜盛廷义
一种芯片间的数据传输方法
本发明公开了一种芯片间的数据传输方法，包括以下步骤：1)对所要传输的数据进行编码，得到串行格式的数据，根据串行格式的数据生成纠错码，其中，串行格式的数据帧构成包括数据的起始位、逻辑通道、数据实体、数据的纠检错位和保护间隙...
张佳盛廷义唐威
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一种单发射五级流水处理器的精确异常处理方法
本发明专利公开了一种单发射五级流水处理器的精确异常处理方法，在流水线各单元中通过流水级间寄存器组依次相连，流水级间寄存器组中含有异常标志寄存器和指令废除标志寄存器；在取指级中增设异常检测模块、功耗控制模块、三输入或门、多...
陈庆宇盛廷义段青亚吴龙胜
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