赖琳晖
- 作品数：12 被引量：6H指数：2
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- 相关领域：电子电信文化科学更多>>
- 一种低复杂度DDFS的设计与ASIC实现被引量：2
- 2009年
- 提出了一种基于ROM结构的直接数字频率综合器(DDFS)的实现算法和实现结构。采用三角函数分解法,降低了其对ROM的需求;并对电路进行优化设计,采用简单的移位相加,节省了乘法器,从而降低了整个电路的复杂度。用标准Verilog HDL实现整个DDFS;采用SMIC0.18μmCMOS工艺库进行设计和实现。经仿真测试,该方法输出的频谱杂散大于60dBc,仅需344位的ROM,工作频率可达100MHz。整个DDFS的芯片面积为300μm×350μm。可满足大多数无线通信系统的要求。
- 刘静赖琳晖李小进雷奥顾彬赖宗声
- 关键词：ROMASIC
- 兼容DVB-T/DTMB的数字电视解调器中数字前端设计研究
- 地面数字电视技术发展逐渐成熟,从模拟电视转向数字电视已经是种势不可挡的趋势,各种数字电视传输标准被相继开发应用,其中欧洲的数字地面电视传输标准DVB-T在全世界范围内广泛运用,中国也制定了自己的标准DTMB。目前,作为数...
- 赖琳晖
- 关键词：DVB-TDTMB内插器数字下变频
- 文献传递
- 可编程CMOS信号输出缓冲器
- 一种可编程CMOS信号输出缓冲器，属于数模混合电路及信号处理的技术领域，利用数字信号对十二个编程点进行的编程配置，控制信号输出缓冲器的驱动能力以及输出信号的摆率和速度以达到驱动能力和传输速度可调，从而适应各种不同数据传输...
- 陈子晏陈磊赖宗声刘琳杨华周灏赖琳晖雷奥马和良欧阳炜霞徐琳
- 文献传递
- 可编程输入缓冲器
- 一种可编程输入缓冲器，属于接口电路的技术领域，含差分比较器模块，单端施密特触发器模块和可编程延迟模块，利用2位数字信号编程实现不同协议标准的通路选择，差分比较器模块对有基准电压要求的协议进行比较整形，转化为数字信号，单端...
- 陈磊雷奥赖宗声刘琳陈子晏杨华马和良赖琳晖周灏欧阳炜霞
- 文献传递
- 一种直接数字频率综合器
- 一种直接数字频率综合器，特别适于用来产生数字正弦、余弦波形的信号，属频率综合的技术领域。该综合器利用三角函数的对称性和相角分解法来减少存储器的存储量，用移位寄存器和加法器代替乘法器，有电路简单和功耗低的优点。该综合器特别...
- 赖琳晖李小进赖宗声雷奥陈磊马和良
- 文献传递
- 延迟锁相环控制模块的VLSI设计与实现被引量：1
- 2008年
- 介绍了一种可用于DLL的控制模块,设计了控制模块的具体电路,并着重优化了控制算法,使其锁定速度快、支持的输入时钟信号频率范围大、延迟信号相位抖动小。采用SMIC 0.18μm CMOS工艺库进行设计和实现。经仿真测试,电路工作范围可达到10 MHz～1 GHz,最大锁定周期为32个输入时钟周期,最大相位抖动小于28 ps。整个控制模块芯片面积为300μm×350μm。
- 赖琳晖周灏雷奥李小进赖宗声
- 关键词：延迟锁相环控制模块相位抖动VLSI
- 高速鉴相器
- 一种高速鉴相器，确切说，涉及一种基于单相时钟动态CMOS技术的高速鉴相器，属于信号处理及其电路的技术领域。在传统的鉴相器的基础上，在反馈环路中添加了一个延时模块，使鉴相器工作时没有死区，用高速的D触发器替换了传统的低速的...
- 马和良雷奥赖宗声周灏赖琳晖陈磊杨华刘琳陈子晏欧阳炜霞
- 文献传递
- 可编程CMOS信号输出缓冲器
- 一种可编程CMOS信号输出缓冲器，属于数模混合电路及信号处理的技术领域，利用数字信号对十二个编程点进行的编程配置，控制信号输出缓冲器的驱动能力以及输出信号的摆率和速度以达到驱动能力和传输速度可调，从而适应各种不同数据传输...
- 陈子晏陈磊赖宗声刘琳杨华周灏赖琳晖雷奥马和良欧阳炜霞徐琳
- 文献传递
- 高速鉴相器
- 一种高速鉴相器，确切说，涉及一种基于单相时钟动态CMOS技术的高速鉴相器，属于信号处理及其电路的技术领域。在传统的鉴相器的基础上，在反馈环路中添加了一个延时模块，使鉴相器工作时没有死区，用高速的D触发器替换了传统的低速的...
- 马和良雷奥赖宗声周灏赖琳晖陈磊杨华刘琳陈子晏欧阳炜霞
- 文献传递
- DVB-T中多速率DDC的设计与FPGA实现
- 2008年
- 针对DVB-T标准ETSI EN300744V1.5.1,设计了可用于DVB-T接收整机的多速率DDC模块,并在FPGA中仿真实现。在复用数字振荡混频模块的基础上,根据输入信号的不同带宽(6M/8MHz)选择不同的抽取滤波器组完成抽取因子为3或4的多速率处理任务,利用两级半带滤波器(HBF)级联完成4倍抽取滤波,单级奈奎斯特滤波器完成3倍抽取滤波。
- 赖琳晖雷奥李小进赖宗声孙卓
- 关键词：DVB-T数字下变频多速率半带滤波器多相滤波
