钱刚
- 作品数：10 被引量：24H指数：3
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- 一种间接获取大功率MESFET管芯S参数的新方法
- 1999年
- 文章测量了单胞、双胞、六胞大功率MESFET的S参数，通过精确的误差控制，进行数据处理，得到了单胞拟合成双胞、单胞拟合成六胞的S参数，通过比较得出了一种间接获取大功率管芯S参数的方法，实验证明，此办法简单可行。
- 钱刚杨晓平吴龙胜顾聪刘佑宝
- 关键词：MESFET微波器件S参数
- LS MPP协处理器的通信机制及其VLSI实现被引量：2
- 2002年
- 文章首先介绍了LSMPP协处理器的通信机制,即通信网络、通信部件及通信调度的设计。通信网络采用网格互连并补充沿行或沿列的播送互连,非常适合图像匹配算法;通信部件穴路由器雪把位并行互连转换为位串行互连,从而减少芯片的设计复杂度及实现小型化目标;同时通过适当的指令调度策略实现路由器指令和其它指令的并行执行,指令的并行可以使数据交换隐含的实现,较好的解决了PE间的通信瓶颈问题,着重讨论了在版图设计中时钟控制信号的走线问题。
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- 关键词：通信机制VLSI超大规模集成电路
- 运动估计协处理器的设计
- 2002年
- 设计了一个运动估计协处理器，用来从硬件的角度解决图像匹配的实时性问题。首先介绍图像处理中的运动估计技术，然后介绍运动估计技术中常用的块匹配算法及判据的选择，最后详细介绍了运动估计协处理器的设计及其实现。
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- 关键词：协处理器VLSI
- 一种适用于多媒体处理器的MAC单元的设计被引量：3
- 2002年
- 多媒体处理经常包括许多乘加操作 .给出了一种新型的适用于多媒体处理器的 MAC单元的设计 ,它用两个 8b× 8b的乘法器来完成 3种不同字长情况下的乘加操作 :第 1种情况是 16 b× 16 b整数或序数乘加 ;第 2种情况是 8b× 16 b、16 b× 8b或 8b× 8b整数或序数乘加 ,其中 8位被乘数又可以分为高字节和低字节两种 ;第 3种情况是两个 8b× 8b整数或序数乘加并行操作 .除第 1种情况需要 2个周期外 ,其余操作都可在 1个周期内完成 ,且其在AT2
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- 关键词：多媒体处理器MAC乘法器加法器BOOTH编码部分积
- 浮点加法器中进位传递问题的合并处理被引量：5
- 2001年
- 文章首先介绍了浮点加法器中可能存在的三个进位传递问题，然后论述了这三个进位传递问题合并实现的可行性，最后给出了一种合并设计的方法，并应用于LS RISC微处理器芯片中，缩短了运算路径及芯片的面积，提高了芯片的性能。
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- 关键词：浮点加法器微处理器芯片
- 数据缓冲器的低功耗设计
- 2004年
- 首先介绍“九五”期间研制的LSMPP协处理器的数据缓冲器的功能与设计 ,并从降低活动因子的角度提出了一种针对低功耗的改进 ,如果阵列的大小为N×N ,则功耗可以降低到“九五”期间方案的 1/N 然后又提出一种针对引出头的减少的改进方法 ,引出头的减少是与互连方案有关的 ,一路串行互连方案可以减少 4N个 ,两路并行互连方案可以减少 8N个 最后提出了一种新的数据缓冲器的设计方案 ,每一时刻只有一个PE的数据缓冲器是传送数据的 ,功耗降低为“九五”期间方案的 1/ (N×N) 。
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- 关键词：阵列低功耗门控时钟
- LS SIMD微处理器中的三组指令并发执行的设计被引量：2
- 2002年
- 文章介绍了LSSIMD微处理器中实现三组指令并发执行的可能性和必要性,分析了三组指令并发执行给流水线带来的影响,并讨论了控制逻辑对三级指令并发执行的控制及其实现形式。
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- 关键词：流水线控制逻辑
- 微控制器中ALU与移位逻辑的设计与改进被引量：7
- 2004年
- 文章结合8位微控制器IP软核的设计,分析了指令系统的功能与特点,在算法级上对其处理器中数据路径进行了合理的调整与优化,并提出一种将ALU与移位逻辑并行设计的方法。较之于传统的串行设计方法而言,这种并行设计方法不仅描述简单,而且综合得到的电路降低了功耗,具有更快的运算速度,同时并不增加资源消耗。
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- 关键词：微控制器ALUCPU中央处理器
- LSRISC 32位浮点阵列乘法器的设计被引量：7
- 2001年
- 文章介绍 LS RISC中的 32位浮点乘法器的设计，它可用于完成定点 32位整数与序数的乘法操作和 IEEE754规定的单精度扩展浮点数据的乘法。
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- 关键词：微处理器
- 列缓冲器和处理元芯片的整合设计
- 2003年
- 文章首先介绍了LSSIMD微处理器的存储器通信指令功能。它作为独立的芯片实现,带来了较难解决的时序和同步问题。文章就两种情况对这个问题进行了较详细的阐述,从而提出整合设计的必要性。并提出了一种列缓冲器与PE芯片的整合设计的方法,以克服时序问题和同步问题,突出了系统集成的设计思想。
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- 关键词：微处理器
