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浙江省自然科学基金(Y106375)

作品数：5 被引量：19H指数：2
相关作者：杭国强应时彦王国飞任洪波徐月华更多>>
相关机构：浙江大学浙江工业大学杭州师范大学更多>>
发文基金：浙江省自然科学基金国家自然科学基金更多>>
相关领域：电子电信自动化与计算机技术更多>>

文献类型

  • 5篇中文期刊文章

领域

  • 5篇电子电信
  • 1篇自动化与计算...

主题

  • 4篇电路
  • 4篇触发器
  • 3篇低功耗
  • 3篇低功耗设计
  • 3篇功耗
  • 3篇功耗设计
  • 2篇低噪
  • 2篇低噪声
  • 2篇低噪声设计
  • 2篇电流
  • 2篇电流型CMO...
  • 2篇混合集成电路
  • 2篇集成电路
  • 2篇多值逻辑
  • 2篇触发器设计
  • 2篇电流型
  • 1篇电流型CMO...
  • 1篇神经元MOS
  • 1篇双边沿触发器
  • 1篇混合信号

机构

  • 5篇浙江大学
  • 1篇杭州师范大学
  • 1篇浙江大学城市...
  • 1篇浙江工业大学

作者

  • 5篇杭国强
  • 1篇应时彦
  • 1篇李锦煊
  • 1篇徐月华
  • 1篇任洪波
  • 1篇王国飞

传媒

  • 3篇浙江大学学报...
  • 1篇电路与系统学...
  • 1篇固体电子学研...

年份

  • 1篇2012
  • 1篇2009
  • 3篇2007
共 5 条 记 录，以下是 1-5
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排序方式：
新型低噪声电流型CMOS边沿触发器设计被引量：1
2007年
提出以电流信号表示逻辑值的新型低噪声触发器设计,用于高性能混合集成电路的设计中以减少存贮单元开关噪声对模拟电路性能的影响。所提出的设计包括主从型边沿触发器和单闩锁单边沿触发器。单个锁存器的电流型边沿触发器设计是通过在有效时钟沿后产生的窄脉冲使锁存器瞬时导通完成一次取样求值。与主从型触发器相比,单闩锁结构的触发器具有结构简单、直流功耗低的特点。采用0.25μm CM O S工艺参数的HSP ICE模拟结果表明,所提出的电流型触发器工作时,在电源端产生的电流波动远远小于传统的CM O S电路。
杭国强任洪波
关键词：混合集成电路触发器低噪声设计
新型电流型CMOS四值边沿触发器设计被引量：10
2009年
提出3种应用于多值逻辑系统的电流型触发器设计,包括四值主从结构触发器、单闩锁单边沿触发器和单闩锁双边沿触发器.采用电流阈值控制技术简化这些电路的结构.单个锁存器的四值单边沿和双边沿触发器分别利用时钟信号的1个边沿和2个边沿后产生的窄脉冲使锁存器瞬时导通,实现取样求值.单闩锁结构的触发器不仅可以简化电路结构,更重要的是大大降低了电流型触发器的直流功耗.在保持相同数据吞吐量的条件下,应用双边沿触发器可以使时钟信号的频率减半,从而降低时钟网络的动态功耗.采用TSMC 0.25μm CMOS工艺参数的HSPICE模拟结果验证了所提出设计方案的有效性.
杭国强应时彦
关键词：电流型CMOS多值逻辑触发器低功耗设计
低功耗三值双边沿触发器设计被引量：9
2007年
提出了几种分别采用两个锁存器和单个锁存器的三值双边沿触发器设计方案,这些方案包括动态、半静态和静态结构。双锁存器三值双边沿触发器是通过将两个透明的三值闩锁并列构成的。单个锁存器的三值双边沿触发器设计是通过时钟信号的上升沿及下降沿后分别产生的窄脉冲使锁存器瞬时导通完成取样求值。三值双边沿触发器具有对时钟信号的两个跳变均敏感的特点,因此可以抑制时钟信号的冗余跳变。较之三值单边沿触发器,在保持相同数据吞吐量的条件下,采用三值双边沿触发器可使时钟信号的频率减半,从而降低系统功耗。最后给出了采用0.25μmCMOS工艺参数的HSPICE模拟结果及其功耗比较。
杭国强
关键词：多值逻辑触发器CMOS电路低功耗设计
新型钟控神经元MOS采样/保持电路被引量：1
2012年
为实现连续时间信号到离散时间信号的转换,提出一种采用钟控神经元MOS管设计的新型电压型采样保持电路.在设计新方案中,通过引入nMOS阈值补偿单元,克服单管神经元MOS跟随器存在阈值损失这一缺点,提高采样保持电路的精度.采用具有高功能度的钟控神经元MOS管实现采样保持和跟随输出,使所设计的电路具有简单的结构和较低的功耗.对钟控神经元MOS管的SPICE宏模型进行改进,改进后的模型可用于对具有可变浮栅预置电压的电路进行分析.采用TSMC 0.35μm双层多晶硅CMOS工艺参数对设计电路进行HSPICE模拟,并对新设计方案与现有采用神经元MOS管设计的采样保持电路进行比较.模拟结果表明,所提出设计方案明显提高了采样精度,并具有较低功耗.
杭国强李锦煊王国飞
关键词：采样保持电路低功耗设计
用于混合信号集成电路的低噪声电流型触发器被引量：1
2007年
提出了一种以电流信号表示逻辑值的低噪声触发器设计方案,用于在混合集成电路的设计中取代传统的CMOS触发器,以减少存贮单元开关噪声对模拟电路性能的影响.所设计的结构包括主从型单边沿触发器、单闩锁单边沿触发器和单闩锁双边沿触发器.单闩锁结构的触发器不仅可以简化电路结构,更为重要的是它大大降低了电流型触发器的直流功耗.在保持相同数据吞吐量的条件下,应用单闩锁双边沿触发器可以使时钟信号的频率减半,从而进一步降低时钟网络的动态功耗.采用0.25μm CMOS工艺参数的HSPICE模拟结果表明,所提出的电流型触发器工作时,在电源端产生的电流波动远远小于传统的CMOS电路.
杭国强徐月华
关键词：电流型CMOS电路混合集成电路触发器低噪声设计
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