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建立在De Bruijn图架构上的三维片上网络设计被引量：2: 2011年; 提出一种基于De Bruijn图的新型三维片上网络架构方式,利用De Bruijn图直径短、路由简单及容错等特性,实现三维片上网络水平面网络和虚平面网络相结合的分层架构与容错路由算法。利用仿真,在均匀流量和热点流量模型下将该架构与传统架构进行仿真与性能比较,结果表明,与传统的3D_Mesh、XNoTs等架构相比,基于De Bruijn图的三维片上网络架构方式具有较小的网络平均延时与良好的可扩展性。; 陈亦欧胡剑浩凌翔; 关键词：三维集成电路架构网络延时片上网络

余数系统在软件无线电中的应用被引量：1: 2009年; 余数系统由于其良好的并行特性,在乘加密集型的数字信号处理系统中得到了广泛关注,而这正是构建软件无线电系统的关键所在。本文在介绍RNS基本理论的基础上,结合已有的研究成果,指出了基于RNS的数字信号处理系统关键单元及研究现状,并提出了一种基于RNS数值表征系统的DSP系统结构。结合冗余RNS的容错特性和并行性,介绍了一种基于RNS的多路并行正交通信系统,并指出了其在阵列SDR平台和航天级SDR平台设计中的应用。可以预见,在构建未来复杂SDR系统中,RNS将得到广泛应用。; 马上胡剑浩凌翔; 关键词：余数系统软件无线电数字信号处理容错

片上网络的互连问题及解决措施综述: 2009年; 在大规模集成电路工艺的深亚微米时代,片上网络(NoC)互连总线遭遇了来自三个方面的威胁:功耗、传输延时、可靠性,它们已经成为限制NoC性能提高的瓶颈。鉴于总线编码的灵活性和综合处理能力,本文首先分析了多种分别针对功耗、延时、可靠性问题的总线编码处理方案,最后介绍了一种统一的总线编码框架来综合处理这三方面的挑战。; 谢国梁凌翔胡剑浩; 关键词：片上网络总线编码功耗可靠性

面向实时数字信号系统关键链路延时的NoC映射方法研究被引量：4: 2010年; 该文在面向功耗优化的经典NoC设计平台和映射算法基础上,针对实时数字信号处理电路固有的实时性特征,提出了一种新的面向最小化系统关键链路延时的NoC自主映射模型MM-Map。该模型在满足处理单元处理容限和链路带宽的约束下,采用基本遗传算法完成延时目标的优化求解。实验结果表明,该模型能节约一定硬件资源的消耗,得到近似全局最优延时解,映射过程简单,收敛效果好。; 陈庚生陈亦欧胡剑浩; 关键词：数字信号处理 NOC映射遗传算法

以{2^n-1,2^n,2^n＋1}为基的余数系统2^n高性能缩放被引量：2: 2010年; 数值缩放(scaling)的高效VLSI实现是基于余数系统(RNS)的DSP系统的关键问题之一。该文提出了有符号余数系统数值缩放通用算法,并结合基为{2n-1,2n,2n+1}的余数系统特性提出了其优化的2n缩放算法和VLSI实现结构,明确给出了在进行有符号RNS整数缩放时负数情况下所引入的修正常量计算方法。分析表明该方法较级联n个1bit缩放模块实现余数系统2n缩放具有更好的速度、面积和功耗特性,从而易于实现基于RNS的DSP系统。; 马上胡剑浩叶燕龙; 关键词：中国剩余定理数字信号处理余数系统超大规模集成电路

一种有符号余数系统2~n缩放方法及VLSI实现: 2010年; 数值缩放的高效VLSI实现是余数系统(RNS)应用于数字信号处理(DSP)系统中的关键问题之一.文中首先提出了有符号余数系统数值缩放通用算法,明确给出了在负数情况时修正常量的计算方法.在此基础上给出了一种有符号余数系统2n缩放的高效实现方法,该方法利用中国剩余定理和一个较小的冗余基实现基扩展以获取RNS整数的低n比特信息,并借助所引入的冗余基用奇偶检测完成RNS整数的符号检测,同时还提出了冗余基更新方法及负数情况下冗余通道修正常量计算方法.分析结果表明所提出的RNS数值缩放方法的复杂度仅同RNS的动态范围位宽呈线性关系,并避免了使用查找表(LUT).最后,完成了此方法和基于串行方式的2n缩放算法的VLSI实现,在相同约束条件下该方法的面积和功耗均减小了35%左右,而关键路径延时则减小了12%左右,VLSI版图也表明了该方法具有更简单的芯片内联结构.; 马上胡剑浩叶燕龙张林凌翔; 关键词：余数系统超大规模集成电路缩放中国剩余定理

联合不等能力保护和串扰避免的片上总线编码设计被引量：1: 2010年; 在深亚微米工艺时代,线间串扰限制了片上互连总线的传输速率,增加了功耗,同时也影响了传输可靠性。针对基于存储转发路由策略的片上网络,采用一个统一编码框架,将不等能力保护码与串扰避免码进行联合设计,以得到高速、可靠和低功耗的片上总线编码方案。通过采用SMIC0.13μmCMOS工艺的仿真结果表明,在同等可靠性要求下,对10mm32bit并行总线采用联合编码方案与未编码方案相比,可以获得38.25%的功耗改善和1.589倍的速度提升。; 谢国梁凌翔; 关键词：串扰片上网络总线编码

三维片上网络拓扑研究被引量：6: 2009年; 三维片上网络是集成电路领域的新技术,用于解决目前片上系统集成度越来越高所面临的通信瓶颈。本文介绍了当前三维片上网络的拓扑和相关技术,提出了三种新型的基于DeBruijn图的拓扑,并对各种拓扑的性能参数进行了比较。; 陈亦欧胡剑浩凌翔; 关键词：片上网络三维封装拓扑

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国家高技术研究发展计划(2007AA01Z291)