深圳市科技计划项目(200512)
- 作品数：12 被引量：17H指数：3
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- 一个8位110 kSPS逐次逼近型A/D转换器被引量：1
- 2008年
- 探讨和研究逐次逼近型A/D转换器(ADC)。理论分析了它的原理和一般结构,给出了一个具体结构的ADC框图和多个具体的子模块电路图;并通过实验仿真,构造了一个分辨率为8位、采样速率达110 kSPS的逐次逼近型ADC,给出了具体的实验仿真结果,以此验证该电路结构的可行性。
- 夏礼胜王百鸣
- 关键词：A/D转换器数据转换器
- 一种二极管桥结构7位60 MSPS采样保持器
- 2007年
- 提出了一种二极管桥结构的采样保持器。理论分析和实验仿真结果表明，该采样保持器采样率达60MSPS，在0．6～5．0MHz输入信号频率范围内，其有效位数达到7．43～6．68位。利用这种二极管桥结构的电压差异，可以降低保持电容上的电压跌落率，提高精度和采样率。
- 孟晓胜王百鸣潘志铭
- 关键词：采样率总谐波失真
- 提高A/D转换速度的新方法—电流模式的余差电路
- 2008年
- 电流模式电路具有转换速度高、频带宽、电压低、功耗低等特点。这些特点在日益追求转换速度和精度的A/D转换器中可得到充分利用。这也是A/D转换器发展的一个重要方向。利用OPA861跨导型放大器,设计了一种电流模式的余差电路,其带宽可达60 MHz,而延迟时间仅为2 ns以内。一般电压模式电路的带宽只能达到2 MHz,延迟为0.1μs以上。基于此余差电路的分级式A/D转换器,其分辨率达到2+8位,最大采样率可达60 MSPS。
- 陈静秋王百鸣彭文达
- 关键词：A/D转换器电流模式
- 一种流水型40 MSPS高速采样保持器
- 2006年
- 通过理论分析和实验仿真,提出了一种流水型高速采样保持器电路(S/H)。采用4个采样率为10 MSPS的S/H,构成一个流水型电路结构的S/H,采样率达到40 MSPS。文章提出的电路结构,在一定程度上解决了采样速率与精度的矛盾关系,可以在组合S/H精度等同于单个S/H精度的前提下,将组合S/H采样速率提高到单个S/H的数倍。
- 闫杰王百鸣
- 关键词：采样速度采样精度
- 9位50 MSPS流水线结构A/D转换器研究被引量：3
- 2008年
- 提出了一个采用三级流水线技术的9位50 MSPS A/D转换器,具体分析了其内部结构,给出了在OrCAD/PSpice 10.5下的仿真结果和动态测试结果;对设计流水线A/D转换器的关键问题进行了讨论,分析了引入流水线技术的优点和缺点。
- 洪岳炜王百鸣
- 关键词：A/D转换器
- 基于采样保持器的滤波电路研究被引量：2
- 2006年
- 研究和探讨了基于采样保持器的滤波电路———采样保持滤波SHF电路,即利用采样保持器的采样保持特性,对某些特定波形模拟信号进行滤波处理。理论分析表明,这种SHF电路是可行的;实验仿真也证实,相对于传统的有源RC滤波电路,这种SHF电路具有更优异的处理效果。SHF电路结构在一定程度上解决了有源RC滤波电路对某些特定信号处理不足的问题。
- 闫杰王百鸣
- 关键词：信号处理
- 一种12位双斜积分式A/D转换器被引量：3
- 2008年
- 研究了一种高分辨率双斜积分式A/D转换器。通过理论分析和实验仿真,构造了一个采样速率为120 SPS、分辨率达12位的A/D转换器电路;给出了0.2%精度下采样值模数转换的仿真结果,并进行了分析,以验证这种电路结构的可行性及优势。
- 乐秋红王百鸣洪岳炜郭宝平
- 关键词：A/D转换器模拟集成电路
- 8位10MSPS流水折叠式ADC的性能测试和分析被引量：1
- 2008年
- 利用信号完整性分析方法,研究探讨了高速ADC的性能指标测试问题。通过实验仿真,对一个自主设计的分辨率为8位、采样速率最高达10 MSPS的高速流水折叠式ADC进行了相关测试分析;分别给出了静态和动态测试结果。结果表明,信号完整性分析方法可以有效地用于高速中分辨率ADC的动态和静态测试。
- 王百鸣闫杰洪岳炜
- 关键词：A/D转换器信号完整性分析谐波失真
- 基于模拟余量A2理论的2位40 MSPS ADC＋和2＋4位40 MSPS ADC被引量：3
- 2008年
- 实施一种新的解决方案,将能输出模拟余量A2的独特ADC+应用于各类A/D转换器芯片,以构成性能扩展的复合A/D转换器。该ADC+是折叠式2位40 MSPS A/D转换器,应用于分级流水结构的4位40 MSPS A/D转换器,构成了复合2+4位40 MSPS A/D转换器。给出了实际电路的理论分析和实验测试结果,表明了此种解决方案的可行性及优点。
- 王百鸣孟晓胜闫杰潘志铭
- 关键词：折叠
- 一种双采样保持器6位20 MSPSA／D转换器被引量：1
- 2008年
- 提出了一种双采样保持器的6位20 MSPS A/D转换器。电路采用两个彼此串联的采样保持器和一个3位并行式A/D转换器。伴随着20MHz双相差分时钟,3位并行式A/D转换器在时钟前半周期转换出高3位数字,并产生3阶模拟余量;在时钟后半周期,再利用该余量转换出低3位数字。既充分利用时钟时间,又充分提高了器件的利用率,大大降低了器件成本。通过实验仿真,进行了相关测试分析,给出了动态测试结果。
- 洪岳炜王百鸣陈静秋
- 关键词：A/D转换器
