国家科技重大专项(2012ZX03001033)
- 作品数：8 被引量：10H指数：2
- 相关作者：宋春林董航柏亮宋超凡何文青更多>>
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- 相关领域：电子电信自动化与计算机技术更多>>
- 考虑X2接口时延的系统仿真方法与CoMP性能分析
- 2013年
- 为了评估LTE-A系统中X2接口时延对多点协作传输(CoMP)技术的实施所带来的影响,建立了有时延的系统信道模型,搭建了非零时延CoMP技术的系统级仿真平台,仿真了3种典型的CoMP方案.分析了系统性能、协商复杂度以及时延敏感程度的关系,指出系统性能随着时延的增加而急剧下降,系统对时延的敏感度随着协商复杂度的提高而增加,在回程时延大到一定值时,CoMP技术便不再适用于LTE-A系统.
- 周文安王国伟张屹宇李慧琴任晓涛
- 关键词：时延系统级仿真
- 一种基于变步长的同频干扰消除算法被引量：1
- 2014年
- 在迅猛发展的移动通信业务中,为了提高频谱利用率可以降低频率复用因子,但却带来了同频干扰。基于此,文中提出一种变步长的同频干扰消除算法。采用变步长滤波器,变步长是指将步长因子随接收信号相关矩阵的特征值的改变而改变。解决了MIC算法难以平衡复杂度与失调之间的问题。文中在具有瑞利衰减和多径效应的信道下对算法进行了性能仿真,仿真结果表明,此算法平衡了算法复杂度和失调,拥有更好的同频干扰消除性能,且性能稳定。
- 鲍林芳董航宋春林朱舞雪
- 关键词：频谱利用率同频干扰变步长
- 一种基于归一化的抗同频干扰算法被引量：1
- 2013年
- 在移动通信系统中,降低频率复用因子可以很好地提升频谱利用率,但同时也带来了同频干扰问题,使用MIC算法可以有效地消除同频干扰,但其仍存在时间复杂度与性能难以调和、收敛速度慢等不足。为此,提出了一种改进型的归一化MIC算法,该算法是最小化干扰原理的一种表现形式,其中的自适应滤波器的权向量在从一次迭代到下一次中,应当以最小方式改变,而且受到更新的滤波器输出所施加的约束。仿真结果表明,算法在保证稳定性和不增加时间复杂度的条件下,拥有更好的同频干扰消除性能。
- 曹琦宋春林柏亮宋超凡
- 关键词：移动通信同频干扰归一化
- 一种基于二次迭代的同频干扰消除算法
- 2013年
- 在移动通信系统中,为了在目前有限的频率资源上提高系统的容量,通常采用降低小区复用因子的方法,但却引入了同频干扰,因此,提出了一种基于二次迭代的同频干扰消除算法。该算法在传统单频干扰消除算法的基础上进行了改进,解决了在时变参数情况下单频干扰消除算法估计出的参数值往往滞后于真实值的问题。仿真结果表明,该算法相对于传统单频干扰消除算法在性能有上所提高,能有效消除同频干扰,且性能稳定。
- 陆鹏宋春林柏亮宋超凡
- 关键词：移动通信同频干扰
- 基于并行分量译码的分段拟合Turbo码译码
- 2013年
- 为减小迭代译码和Log-MAP算法因运算复杂度高而引起的译码延迟,同时保证其低误码率性能,提出了一种基于并行分量译码的分段拟合Turbo码译码方案。该方案首先改变了传统分量译码器的串行结构,两个分量译码器并行译码;其次利用最小二乘法分段线性拟合Log-MAP算法中的相关函数,能有效降低译码延迟和运算复杂度。最后仿真表明新方案与传统译码相比有一致的误码率性能,且迭代时间缩短了一半。
- 陶玥琛宋春林柏亮宋超凡
- 关键词：TURBO码迭代译码LOG-MAP算法
- DVB-T中Viterbi译码器的设计及FPGA实现被引量：2
- 2014年
- Viterbi作为一种最大似然译码算法广泛应用在数字地面视频广播中,但由于其较高算法复杂程度,对实现高速低功耗时延小且逻辑结构简单的译码器带来了挑战。首先为了实现高速的Viterbi译码器,ACSU采用全并行结构,度量值的溢出控制采用取模归一化方法,并简化比较器。其次为了实现低功耗时延小且控制逻辑简单的Viterbi译码器,SMU采用改进的前向追溯结构,只用一组单口的RAM实现译码输出。该译码器在Xilinx Virtex6上实现并验证通过,并具有较好的译码性能。
- 薛伟宏宋春林兰利宝刘成强
- LTE下行链路EVM测量算法的研究被引量：2
- 2014年
- EVM(误差矢量幅度)是移动通信系统终端测试指标的重要内容,它与其它常规指标(如眼图或BER测量)相比能更直观快速地反映信号的质量,已成为目前终端测试的研究热点。在传输过程中,由于信号受到噪声等因素的影响,会造成EVM测量值不准的问题。因此,基于3GPP标准,设计并实现了一种LTE下行链路EVM测量算法。本算法利用插值、查找最优测量位置和频偏补偿等处理,使最终的EVM测量值更接近真实值。算法测试结果表明,本算法的测量结果较为准确,测量时间较短,具有实际应用意义。
- 卜灿星宋春林杜佳董航
- 关键词：误差矢量幅度频偏补偿
- 数字锁相环提取位同步信号的改进与实现被引量：4
- 2015年
- 传统的数字锁相环电路通过相位比较器控制添/扣门调整分频器计数脉冲从而调整相位,但每次仅能调整一步。这不能满足快速建立位同步的要求且对相位调整的步进也缺乏灵活性。提出了用可编程器件实现改进型数字锁相环的方案,使得相位比较器在判决的同时计算出分频器分频计数值误差,并用得出的误差值去补偿分频器的分频计数值。同时将分频器、添门和扣门合并为一个可以加载不同模值的可变模分频器,解决了原来数字锁相环位同步建立慢的缺点。该方法通过VHDL语言实现,并在Quartus II上验证通过,实现了位同步信号的提取。
- 何文青宋春林董航周英华
- 关键词：位同步数字锁相环
